题目内容

当三位二进制加法计数器初始状态为101时,经过2014个时钟后状态将变为( )。

A. 011
B. 110
C. 100
D. 001

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当四位二进制加法计数器初始状态为1001时,经过2015个时钟后状态将变为( )。

A. 0111
B. 1100
C. 1000
D. 0010

时序逻辑电路的输出( )。

A. 只与当前的输入有关
B. 只与电路当前状态有关
C. 与当前电路的输入和状态均有关
D. 与输入和电路当前状态均无关

下列逻辑电路中( )为时序逻辑电路。

A. 显示译码器
B. 寄存器
C. 数据分配器
D. 加法器

十进制计数器74LS160含有的触发器的个数是( )。

A. 2
B. 4
C. 8
D. 10