Verilog有4种循环语句，不可综合的循环语句是：
A. for
B. while
C. repeat
D. forever
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always语句中的敏感信号列表，表述正确的有：
A. 用or连接所有敏感信号
B. 用逗号区分所有敏感信号
C. 省略形式 always @*
D. 省略形式 always @（*）
设计模块中的任何顺序语句都必须放在过程语句结构中。
A. 对
B. 错
The price of house has risen ______.
The two parties have reached a ______ agreement.
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