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4位二进制计数器Q3Q2Q1Q0的输出Q2是时钟CLK的分频。

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组合逻辑电路在结构上由构成，时序逻辑电路在结构上必须包含器件。

移位寄存器中的触发器可以选用电平触发的D触发器构成。（）

A. 对
B. 错

构成4位寄存器，至少需要2个触发器。（）

A. 对
B. 错

构成4位寄存器，至少需要4个触发器。（）

A. 对
B. 错