第6章 硬件描述语言Verilog HDL
1、【单选题】基于EDA技术的现代电子系统设计流程为：原理图/HDL文本输入→功能仿真→（)→布局布线→（)→编程下载→硬件测试。正确的是 （) 。 ①功能仿真 ②时序仿真 ③逻辑综合 ④配置 ⑤分配管脚
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2、【不定项选择题】下列语句中，不属于并行语句的是（）
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3、【单选题】在连续赋值语句中被赋值的变量应该定义为哪种数据类型（)
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4、【单选题】对语句assign Y = sel ？ A : B;进行逻辑综合，得到的硬件电路为 （)
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5、【不定项选择题】已知 a =4’b1010，b=4’b1100，那么a & b＝（）
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6、【单选题】在语句assign Y = sel ？ 0 : 1;中，当sel=0时，Y的值为（)
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7、【单选题】已知 a =2’b10，b=3’b110，那么{a,b}＝（）
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8、【单选题】下列Verilog HDL程序所描述的是一个计数器，该计数器的模是（）module count（CLK,OUT）;input CLK; output reg [3:0] OUT; always @（negedge CLK）begin if（OUT = =4’d11） OUT ＜= 0;else OUT ＜= OUT +1; end endmodule
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9、【单选题】阻塞性赋值运算符为（）
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10、【单选题】下列Verilog HDL程序所描述的电路是（）module MED（Q, DATA,CLK）input DATA,CLK;output Q;reg Q; always @ （posedge CLK） begin Q ＜= DATA; endendmodule
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11、【单选题】如下Verilog HDL程序所描述的是一个触发器，对它的描述正确的是（）module FF（Q,DATA,CLK）input DATA,CLK;output Q;reg Q; always @ （posedge CLK） begin Q ＜= DATA; endendmodule
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12、【多选题】非阻塞性赋值运算符为（）
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13、【单选题】已知 a =4’b1010，b=4’b1100，那么&（a & b)＝（）
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