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假定 DRAM 芯片中存储阵列的行数为 r、列数为 c，对于一个 2K×1 位的 DRAM 芯片，为保证其地址引脚数最少，并尽量减小刷新开销，则 r、 c 的取值分别是（）。

A. 2048、 1
B. 64、 32
C. 32、 64
D. 1、 2048

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下列选项中，可提高同步总线数据传输率的是（）。I. 增加总线宽度 II. 提高总线工作频率III. 支持突发传输 IV. 采用地址/数据线复用

A. 仅 II
B. 仅 IIII
C. 仅 IIIV
D. IIII 和 IV

某存储器容量为 64KB，按字节编址，地址 4000H~5FFFH 位 ROM 区，其余为 RAM 区。若采用 8K× 4 位的 SRAM 芯片进行设计，则需要该芯片的数量是（）。

A. 7
B. 8
C. 14
D. 16

由 4 个“1”和4个“0”组成的 8 位二进制补码，能表示的最小整数是（）。

A. -126
B. -125
C. -32
D. -121

若 x=101， y=-27，则下列表达式采用 8 位定点补码运算实现时，会发生溢出的是（）。

A. x+y
B. -x+y
C. x-y
D. -x-y