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综合是EDA设计流程的关键步骤,在下面对综合的描述中,错误的是()。

A. 综合就是把抽象设计层次中的一种表示转化成另一种表示的过程;
B. 综合就是将电路的高级语言转化成低级的,可与FPGA / CPLD的基本结构相映射的网表文件;
C. 为实现系统的速度、面积、性能的要求,需要对综合加以约束,称为综合约束;
D. 综合可理解为,将软件描述与给定的硬件结构用电路网表文件表示的映射过程,并且这种映射关系是唯一的(即综合结果是唯一的)

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下列EDA软件中,哪一个不具有逻辑综合功能()。

A. Vivado
B. ModelSim
C. Quartus II
D. Synplify

执行EDA中的()命令,可以检查设计电路的描述错误。

A. Create Default Symbol
B. Compiler
C. Simulator
D. Timing Analyzer

在VHDL中用()过程把特定的结构体关联一个确定的实体,为一个大型系统的设计提供管理和进行工程组织。

A. 输入
B. 输出
C. 综合
D. 配置

下面对利用原理图输入设计方法进行数字电路系统设计,那一种说法是不正确的()。

A. 原理图输入设计方法直观便捷,但不适合完成较大规模的电路系统设计;
B. 原理图输入设计方法一般是一种自底向上的设计方法;
C. 原理图输入设计方法无法对电路进行功能描述;
D. 原理图输入设计方法也可进行层次化设计。

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