题目内容

构成时序逻辑电路的基本单元电路是（）。

A. 与非门
B. 或非门
C. 同或门
D. 触发器

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若设计0、1、2、3、4、5、6、7，这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用（）级触发器？

A. 2
B. 3
C. 4
D. 8

若设计构成一个模12递增计数器一共需要（）个触发器。

A. 3
B. 10
C. 2
D. 4

已知时钟脉冲频率为f，要得到频率为0.2f的矩形波，可以采用（）。

A. 555定时器
B. 五位二进制计数器
C. 五进制计数器
D. 五位扭环形计数器

寻址容量为16k×8的RAM需要（）根地址线。

A. 4
B. 8
C. 14
D. 16