题目内容

在状态机的具体实现时,往往需要针对具体的器件类型来选择合适的状态机编码。顺序编码状态机编码方式适合于()器件.

A. FPGA
B. CPLD

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在一个VHDL设计中Idata是一个信号,数据类型为std_logic_vector,下面赋值语句错误的是()。

A. idata<=“00001111”
B. idata<=b”0000_1111”
C. idata<=X”AB”
D. idata<=B”21”

转换函数TO_BITVECTOR()的功能是。

A. 将STDLOGIC_VECTOR转换为BIT_VECTOR
B. 将REAL转换为BIT_VECTOR
C. 将TIME转换为BIT_VECTOR
D. 前面的说法都错误

VHDL中顺序语句放置位置说法正确的是()。

A. 可以放在进程语句中
B. 可以放在子程序中
C. 不是任意位置
D. 前面的说法都正确

执行下列语句后Q的值等于()。……SIGNALE:STD_LOGIC_VECTOR(2TO5);SIGNALQ:STD_LOGIC_VECTOR(9DOWNTO2);……E<=(2=>’1’,4=>’0’,OTHERS=>’1’);Q<=(2=>E(2),4=>E(3),5=>’1’,7=>E(5),OTHERS=>E(4));……

A. “11011011”
B. “00101101”
C. “11011001”
D. “00101100”