时序逻辑电路按照其触发器是否有统一的时钟控制，分为（）时序逻辑电路和（）时序逻辑电路。
A. 同步，异步
B. 加法，减法
C. 上升沿，下降沿
D. 高电平，低电平
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组合逻辑电路的基本单元是（ ），时序逻辑电路的基本单元是（ ）
A. 电子元件，数字电子元件
B. 门电路，触发器
C. 触发器，门电路
D. 逻辑电路，触发电路
同步时序电路和异步时序电路比较，其差异在于后者（）
A. 有统一的时钟脉冲控制
B. 没有统一的时钟脉冲控制
C. 没有稳定状态
D. 输出只与内部状态有关
在触发器中，时钟脉冲CLK是作为（ ）
A. 直接置位信号
B. 控制信号
C. 输入信号
D. 直接复位信号
4个触发器构成的计数器最多有（）个有效状态。
A. 4
B. 8
C. 10
D. 16
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