题目内容

逻辑综合阶段包括语法检查和设计规则检查、网络表提取以及逻辑优化和综合()。

A. 对
B. 错

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元件例化语句位置关联时位置必须一一对应。（）

A. 对
B. 错

布尔类型只能进行关系运算，不能进行算术运算。（）

A. 对
B. 错

时间类型可以用于逻辑综合。（）

A. 对
B. 错

Verilog 语言运算符没有优先级。（）

A. 对
B. 错