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对于低电平是输出有效电平的译码器,每个输出都是________。若以这种类型的译码器实现组合逻辑电路时,还需要增加____。

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组合逻辑电路在任一时刻输出信号的稳态值由 决定,与 无关。

对于集成组合逻辑电路,主要通过 来掌握其各管脚的逻辑功能,还应判别其 权的排列以达到正确使用。

能将特定信息转换成机器识别的 制数码的组合逻辑电路,称为 器;

能将机器识别的____制数码转换成人们熟悉的 制或某种特定信息的组合逻辑电路,称为 器

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