题目内容

四输入的译码器，其输出端最多为（ D ）。

A. 4个
B. 8个
C. 10个
D. 16个

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对于高电平是输出有效电平的译码器，每个输出都是____。若以这种类型的译码器实现组合逻辑电路时，还需要增加。

对于低电平是输出有效电平的译码器，每个输出都是____。若以这种类型的译码器实现组合逻辑电路时，还需要增加。

组合逻辑电路在任一时刻输出信号的稳态值由决定，与无关。

对于集成组合逻辑电路，主要通过来掌握其各管脚的逻辑功能，还应判别其权的排列以达到正确使用。