题目内容

Verilog HDL各always语句是并行执行的，而且内部是顺序执行的()。

A. 对
B. 错

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Verilog程序一行可以写几个语句，一个语句也可以分多行写。（）

A. 对
B. 错

组合逻辑中不能用锁存器，时序逻辑中可以用锁存器()。

A. 对
B. 错

代码中两个常数乘法运算可以直接使用*进行()。

A. 对
B. 错

包括参量(parameter)名，文本宏等常量可以用小写字母表示()。

A. 对
B. 错