基于EDA软件的FPGA/CPLD设计流程为:原理图/HDL文本输入→()→综合→适配→时序仿真→编程下载→硬件测试。
A. 功能仿真
B. 时序仿真
C. 逻辑综合
D. 配置
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基于EDA软件的FPGA/CPLD设计流程中有两次验证过程,经过适配后进行的仿真是()。
A. 功能仿真
B. 时序仿真
C. 逻辑综合
D. 配置
综合是EDA设计流程的关键步骤,在下面对综合的描述中,错误的是()。
A. 综合就是把抽象设计层次中的一种表示转化成另一种表示的过程;
B. 综合就是将电路的高级语言转化成低级的,可与FPGA / CPLD的基本结构相映射的网表文件;
C. 为实现系统的速度、面积、性能的要求,需要对综合加以约束,称为综合约束;
D. 综合可理解为,将软件描述与给定的硬件结构用电路网表文件表示的映射过程,并且这种映射关系是唯一的(即综合结果是唯一的)
下列EDA软件中,哪一个不具有逻辑综合功能()。
A. Vivado
B. ModelSim
C. Quartus II
D. Synplify
执行EDA中的()命令,可以检查设计电路的描述错误。
A. Create Default Symbol
B. Compiler
C. Simulator
D. Timing Analyzer
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