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保存Verilog HDL文件时,文件名必须与模块名保持一致。

A. 对
B. 错

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三人表决器的功能为,当同意人数为两人以上时,表决结果为通过,否则为不通过。

A. 对
B. 错

在VerilogHDL语言中,符号&&表示逻辑与。

A. 对
B. 错

在VerilogHDL语言中,符号|表示逻辑非。

A. 对
B. 错

在Verilog HDL语言中,赋值符号为 == 。

A. 对
B. 错

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