在下列Verilog HDL运算符中，属于三目运算符的是（）。
A. &&
B. !==
C. ?:
D. ===
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当a<0时，s的值是（）。assign s=(a>2)?1:(a<0)?2:0
A. 0
B. 1
C. 2
D. 其他
在Verilog中，下列语句哪个不是分支语句？（）
A. if...else
B. case
C. casez
D. repeat
下列关于Verilog HDL语言的描述中，不正确的选项是（）。
A. Verilog HDL可实现并行计算，C语言知识串行计算；
B. Verilog HDL语言可以描述电路结构，C语言仅仅描述算法；
C. Verilog HDL语言源于C语言，包括它的逻辑和延迟；
D. Verilog HDL可以编写测试向量进行仿真和测试。
关于过程块以及过程赋值语句的描述中，下列正确的是（）。
A. 在过程赋值语句中表达式左边的信号一定是寄存器类型；
B. 过程块中的语句一定是可综合的；
C. 在过程块中，使用过程赋值语句给wire赋值不会产生错误；
D. 过程赋值语句以关键词assign为先导
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